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Titolo Data di pubblicazione Autore(i) File
A Novel Approach to Design Space Exploration of Parameterized SOCs 1-gen-2001 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio file da validare
Parameterised System Design Based on Genetic Algorithms 1-gen-2001 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio file da validare
An Instruction-Level Power Analysis Model with Data Dependency 1-gen-2001 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio; Sarta, D.
An evolutionary approach for Pareto-optimal configurations in SOC platforms 1-gen-2002 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio file da validare
Tuning methodologies for parameterized systems design 1-gen-2002 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio file da validare
A Framework for Design Space Exploration of Parameterized VLSI Systems 1-gen-2002 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio file da validare
Tuning methodologies for parameterized systems design 1-gen-2002 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio file da validare
Multi-objective design space exploration using genetic algorithms 1-gen-2002 Palesi, Maurizio; Givargis, T. file da validare
Design Space Exploration Methodologies for IP-based System-on-a-chip 1-gen-2002 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio file da validare
A genetic approach to bus encoding 1-gen-2003 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio; Parlato, A. file da validare
EPIC-Explorer: A parameterized VLIW-based platform framework for design space exploration 1-gen-2003 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio; Patti, Davide file da validare
EPIC-Explorer: A Parameterized VLIW-based Platform Framework for Design Space Exploration 1-gen-2003 G., Ascia; Catania, Vincenzo; Palesi, Maurizio; Patti, Davide file da validare
A Genetic Bus Encoding Technique for Power Optimization of Embedded Systems 1-gen-2003 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio file da validare
An evolutionary approach for reducing the switching activity in address buses 1-gen-2003 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio; Parlato, A. file da validare
Power/Energy Perspective on Hyperblock Formation 1-gen-2004 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio; Patti, Davide file da validare
Multi-Objective Optimization of a Prameterized VLIW Architecture 1-gen-2004 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio; Patti, Davide file da validare
Multi-objective mapping for mesh-based NoC architectures 1-gen-2004 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio
A GA Based Design Space Exploration Framework for Parameterized System-on-a-Chip Platforms 1-gen-2004 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio
Mapping Cores on Network-on-Chip 1-gen-2005 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio
Multi-objective Genetic Approach for System-level Exploration in Parameterized Systems-on-a-chip 1-gen-2005 Ascia, Giuseppe; Catania, Vincenzo; Palesi, Maurizio
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